实体（ENTITY）描述一个设计单元的（）的信息。

第1题

一个能为VHDL综合器接受,并能作为一个独立的设计单元的完整的VHDL程序成为( )。A.设计输入B.设计输出C.设计实体D.设计结构

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第2题

对于eNB中配置的一个RLC实体，在『____』中对应配置有一个对等RLC实体。(If an RLC entity is configured in eNB,there will be a peer RLC entity in『____』.)

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第3题

●硬件描述语言一般包括VHDL、Verilog、Superlog、SystemC等，在VHDL设计中，一个完整的设计单元应当包含5部分，下面不属于这5部分的是(32)。(32)A．实体B．结构体C．赋值D．配置

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第4题

在典型接口中，第n+1层实体通过SAP把一个( )传递给第n层实体。A．服务数据单元B．协议数据单元C．接口数据单元D．接口控制信息

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第5题

概念设计也要贯彻概念单一化原则, 即一个实体只用来反映一种事实, 一个实体中的所有属性都是用来直接描述码的。( )此题为判断题(对，错)。

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第6题

EXPRESS语言通过一系列的说明来进行描述，这些说明主要包括()。A.类型说明(Type) B.实体说明(Entity) C.规则说明(Rule) D.函数说明(Function) E.材料说明(Materials)

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第7题

EXPRESS语言通过一系列的说明来进行描述，这些说明主要包括（）。A、类型说明（Type）B、实体说明（Entity）C、规则说明（Rule）D、函数说明（Function）E、材料说明（Materials）

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